Haase | Models, Methods, and Tools for Complex Chip Design | Buch | 978-3-319-34823-0 | sack.de

Buch, Englisch, Band 265, 221 Seiten, Previously published in hardcover, Format (B × H): 155 mm x 235 mm, Gewicht: 414 g

Reihe: Lecture Notes in Electrical Engineering

Haase

Models, Methods, and Tools for Complex Chip Design

Selected Contributions from FDL 2012
Softcover Nachdruck of the original 1. Auflage 2014
ISBN: 978-3-319-34823-0
Verlag: Springer International Publishing

Selected Contributions from FDL 2012

Buch, Englisch, Band 265, 221 Seiten, Previously published in hardcover, Format (B × H): 155 mm x 235 mm, Gewicht: 414 g

Reihe: Lecture Notes in Electrical Engineering

ISBN: 978-3-319-34823-0
Verlag: Springer International Publishing


This book brings together a selection of the best papers from the fifteenth edition of the Forum on specification and Design Languages Conference (FDL), which was held in September 2012 at Vienna University of Technology, Vienna, Austria. FDL is a well-established international forum devoted to dissemination of research results, practical experiences and new ideas in the application of specification, design and verification languages to the design, modeling and verification of integrated circuits, complex hardware/software embedded systems, and mixed-technology systems.

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Zielgruppe


Research


Autoren/Hrsg.


Weitere Infos & Material


Formal Plausibility Checks for Environment.- Efficient Refinement Strategy Exploiting Component Properties in A CEGAR Process.- Formal Specification Level.- Power Estimation Methodology for SystemC.- SystemC Analysis for Nondeterminism Anomalies.- A Design and Verification Methodology for Mixed-Signal Systems Using SystemC-AMS.- Configurable Load Emulation Using FPGA and Power Amplifiers for Automotive Power ICs.- Model Based Design of Distributed Embedded Cyber Physical Systems.- Model-driven Methodology for the Development of Multi-level Executable Environments.- The Concept and Study of Grid Responsiveness.- Polynomial Metamodel-Based Fast Optimization of Nanoscale PLL Components.- Methodology and Example-Driven Interconnect Synthesis for Designing Heterogenous Coarse-Grain Reconfigurable Architectures.



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